dt-bindings: clocks: stm32mp25: add description of all parents
RCC driver uses '.index' to define all parent clocks instead '.names'
because the use of a name to define a parent clock is discouraged. This
is an ABI change, but the RCC driver has not yet merged, unlike all
others drivers besides Linux.
Fixes: b5be49db3d
("dt-bindings: stm32: add clocks and reset binding for stm32mp25 platform")
Signed-off-by: Gabriel Fernandez <gabriel.fernandez@foss.st.com>
Acked-by: Krzysztof Kozlowski <krzysztof.kozlowski@linaro.org>
Link: https://lore.kernel.org/r/20240411092453.243633-3-gabriel.fernandez@foss.st.com
Signed-off-by: Stephen Boyd <sboyd@kernel.org>
This commit is contained in:
parent
239d5fb3ba
commit
df5df1257c
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@ -38,14 +38,81 @@ properties:
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- description: CK_SCMI_MSI Low Power Internal oscillator (~ 4 MHz or ~ 16 MHz)
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- description: CK_SCMI_MSI Low Power Internal oscillator (~ 4 MHz or ~ 16 MHz)
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- description: CK_SCMI_LSE Low Speed External oscillator (32 KHz)
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- description: CK_SCMI_LSE Low Speed External oscillator (32 KHz)
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- description: CK_SCMI_LSI Low Speed Internal oscillator (~ 32 KHz)
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- description: CK_SCMI_LSI Low Speed Internal oscillator (~ 32 KHz)
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clock-names:
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items:
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- description: CK_SCMI_FLEXGEN_59 flexgen clock 59
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- description: CK_SCMI_FLEXGEN_62 flexgen clock 62
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- description: CK_SCMI_FLEXGEN_63 flexgen clock 63
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- description: CK_SCMI_ICN_APB1 Peripheral bridge 1
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- description: CK_SCMI_ICN_APB4 Peripheral bridge 4
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- description: CK_SCMI_ICN_APBDBG Peripheral bridge for degub
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- description: CK_SCMI_TIMG1 Peripheral bridge for timer1
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- description: CK_SCMI_TIMG2 Peripheral bridge for timer2
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- description: CK_SCMI_PLL3 PLL3 clock
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- description: clk_dsi_txbyte DSI byte clock
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required:
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required:
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- compatible
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- compatible
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@ -53,7 +120,6 @@ required:
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- '#clock-cells'
|
- '#clock-cells'
|
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- '#reset-cells'
|
- '#reset-cells'
|
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- clocks
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- clocks
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- clock-names
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additionalProperties: false
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additionalProperties: false
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@ -66,11 +132,85 @@ examples:
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reg = <0x44200000 0x10000>;
|
reg = <0x44200000 0x10000>;
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|
#clock-cells = <1>;
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#reset-cells = <1>;
|
#reset-cells = <1>;
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clock-names = "hse", "hsi", "msi", "lse", "lsi";
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|
clocks = <&scmi_clk CK_SCMI_HSE>,
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<&scmi_clk CK_SCMI_HSI>,
|
<&scmi_clk CK_SCMI_HSI>,
|
||||||
<&scmi_clk CK_SCMI_MSI>,
|
<&scmi_clk CK_SCMI_MSI>,
|
||||||
<&scmi_clk CK_SCMI_LSE>,
|
<&scmi_clk CK_SCMI_LSE>,
|
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<&scmi_clk CK_SCMI_LSI>;
|
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|
||||||
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||||||
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|
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|
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|
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|
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|
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<&scmi_clk CK_SCMI_FLEXGEN_16>,
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<&scmi_clk CK_SCMI_FLEXGEN_17>,
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<&scmi_clk CK_SCMI_FLEXGEN_18>,
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<&scmi_clk CK_SCMI_FLEXGEN_19>,
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<&scmi_clk CK_SCMI_FLEXGEN_20>,
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<&scmi_clk CK_SCMI_FLEXGEN_21>,
|
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<&scmi_clk CK_SCMI_FLEXGEN_22>,
|
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<&scmi_clk CK_SCMI_FLEXGEN_23>,
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<&scmi_clk CK_SCMI_FLEXGEN_24>,
|
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<&scmi_clk CK_SCMI_FLEXGEN_25>,
|
||||||
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<&scmi_clk CK_SCMI_FLEXGEN_26>,
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<&scmi_clk CK_SCMI_FLEXGEN_27>,
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<&scmi_clk CK_SCMI_FLEXGEN_28>,
|
||||||
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<&scmi_clk CK_SCMI_FLEXGEN_29>,
|
||||||
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<&scmi_clk CK_SCMI_FLEXGEN_30>,
|
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||||||
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|
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|
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|
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<&scmi_clk CK_SCMI_FLEXGEN_42>,
|
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<&scmi_clk CK_SCMI_FLEXGEN_47>,
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||||||
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<&scmi_clk CK_SCMI_FLEXGEN_48>,
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<&scmi_clk CK_SCMI_FLEXGEN_50>,
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<&scmi_clk CK_SCMI_FLEXGEN_53>,
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<&scmi_clk CK_SCMI_FLEXGEN_55>,
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<&scmi_clk CK_SCMI_FLEXGEN_56>,
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<&scmi_clk CK_SCMI_FLEXGEN_57>,
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<&scmi_clk CK_SCMI_FLEXGEN_60>,
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|
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|
||||||
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|
||||||
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|
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|
||||||
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<&scmi_clk CK_SCMI_PLL3>,
|
||||||
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<&clk_dsi_txbyte>;
|
||||||
};
|
};
|
||||||
...
|
...
|
||||||
|
|
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@ -69,7 +69,7 @@
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#define ADC3_R 59
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#define ADC3_R 59
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#define ETH1_R 60
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#define ETH1_R 60
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|
#define ETH2_R 61
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#define USB2_R 62
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#define USBH_R 62
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||||||
#define USB2PHY1_R 63
|
#define USB2PHY1_R 63
|
||||||
#define USB2PHY2_R 64
|
#define USB2PHY2_R 64
|
||||||
#define USB3DR_R 65
|
#define USB3DR_R 65
|
||||||
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